AEC-Q100 Transceptor Ethernet KSZ9031RNXIC, 1000BASE-T, 100BASE-TX, 10BASE-T, IEEE 802.3, 1 canales, 3,3 V, QFN, 48
- Código RS:
- 177-3873
- Nº ref. fabric.:
- KSZ9031RNXIC
- Fabricante:
- Microchip
64 Disponible para entrega en 24/48 horas
Añadido
Precio unitario (Suministrado en múltiplos de 2)
4,385 €
(exc. IVA)
5,306 €
(inc.IVA)
Unidades | Por unidad | Por Pack* |
2 - 8 | 4,385 € | 8,77 € |
10 - 22 | 4,275 € | 8,55 € |
24 - 98 | 4,16 € | 8,32 € |
100 + | 4,06 € | 8,12 € |
*precio indicativo |
- Código RS:
- 177-3873
- Nº ref. fabric.:
- KSZ9031RNXIC
- Fabricante:
- Microchip
Documentación Técnica
Legislación y Conformidad
- COO (País de Origen):
- US
Datos del Producto
El KSZ9031 reduce el coste de la placa y simplifica su diseño al utilizar las resistencias de terminación integradas en el chip para los cuatro pares diferenciales y un controlador LDO integrado para supervisar un MOSFET de bajo coste y suministrar 1,2 V al núcleo.
Transceptor Ethernet de 10/100/1.000 Mbps de un chip
El dispositivo KSZ9031Mxx tiene una interfaz estándar GMII/MII con E/S con capacidad de 3,3 V/2,5 V/1,8 V
La temporización de RGMII del KSZ9031Rxx admite un retardo en chip según RGMII versión 2.0, con opciones de programación para retardo externo y la realización de ajustes y correcciones en conformidad con las secuencias de temporización de transmisión y recepción
GMII/MII/RGMII con E/S con capacidad de 3,3 V/2,5 V/1,8 V
Autonegociación para seleccionar automáticamente la velocidad de conexión más alta (10/100/1.000 Mbps) y el dúplex (medio/completo)
Resistencias de terminación integradas en el chip para los pares diferenciales
Controlador LDO integrado en el chip para alimentación sencilla de 3,3 V. Solo requiere un FET externo para generar 1,2 V para el núcleo
Compatibilidad con jumbo frame: hasta 16 kB
Salida de reloj de referencia de 125 MHz
Modo de desconexión con detección de energía
El dispositivo KSZ9031Mxx tiene una interfaz estándar GMII/MII con E/S con capacidad de 3,3 V/2,5 V/1,8 V
La temporización de RGMII del KSZ9031Rxx admite un retardo en chip según RGMII versión 2.0, con opciones de programación para retardo externo y la realización de ajustes y correcciones en conformidad con las secuencias de temporización de transmisión y recepción
GMII/MII/RGMII con E/S con capacidad de 3,3 V/2,5 V/1,8 V
Autonegociación para seleccionar automáticamente la velocidad de conexión más alta (10/100/1.000 Mbps) y el dúplex (medio/completo)
Resistencias de terminación integradas en el chip para los pares diferenciales
Controlador LDO integrado en el chip para alimentación sencilla de 3,3 V. Solo requiere un FET externo para generar 1,2 V para el núcleo
Compatibilidad con jumbo frame: hasta 16 kB
Salida de reloj de referencia de 125 MHz
Modo de desconexión con detección de energía
Especificaciones
Atributo | Valor |
---|---|
Estándar Compatible | 1000BASE-T, 100BASE-TX, 10BASE-T, IEEE 802.3 |
Número de Canales por Chip | 1 |
Transmisión de Datos Típica | 1000Mbit/s |
Tipo de Fuente de Alimentación | Único |
Tensión de Alimentación de Funcionamiento Típica | 3,3 V |
Tipo de Montaje | Montaje superficial |
Tipo de Encapsulado | QFN |
Conteo de Pines | 48 |
Dimensiones | 7 x 7 x 0.8mm |
Temperatura Máxima de Funcionamiento | +85 °C |
Temperatura de Funcionamiento Mínima | -40 °C |
Estándar de automoción | AEC-Q100 |
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