Biestable tipo D óctuple 74LVC573APW,118, Transparente Tipo D 8 bits 3 estados TSSOP 20 pines 8bit
- Código RS:
- 170-5424
- Nº ref. fabric.:
- 74LVC573APW,118
- Fabricante:
- Nexperia
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*precio indicativo
- Código RS:
- 170-5424
- Nº ref. fabric.:
- 74LVC573APW,118
- Fabricante:
- Nexperia
Especificaciones
Documentación Técnica
Legislación y Conformidad
Datos del Producto
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Seleccionar todo | Atributo | Valor |
|---|---|---|
| Marca | Nexperia | |
| Familia Lógica | 74LVC | |
| Modo de Enclavamiento | Transparente | |
| Elemento de Enclavamiento | Tipo D | |
| Número de Elementos por Chip | 8 | |
| Número de Bits | 8bit | |
| Número de Canales por Chip | 8 | |
| Tipo de Salida | 3 estados | |
| Polaridad | No Inversión | |
| Tipo de Montaje | Montaje superficial | |
| Tipo de Encapsulado | TSSOP | |
| Conteo de Pines | 20 | |
| Dimensiones | 6.6 x 4.5 x 0.95mm | |
| Altura | 0.95mm | |
| Longitud | 6.6mm | |
| Ancho | 4.5mm | |
| Tensión de Alimentación de Funcionamiento Mínima | 1,2 V | |
| Temperatura de Funcionamiento Mínima | -40 °C | |
| Temperatura Máxima de Funcionamiento | +125 °C | |
| Tensión de Alimentación Máxima de Funcionamiento | 3,6 V | |
| Seleccionar todo | ||
|---|---|---|
Marca Nexperia | ||
Familia Lógica 74LVC | ||
Modo de Enclavamiento Transparente | ||
Elemento de Enclavamiento Tipo D | ||
Número de Elementos por Chip 8 | ||
Número de Bits 8bit | ||
Número de Canales por Chip 8 | ||
Tipo de Salida 3 estados | ||
Polaridad No Inversión | ||
Tipo de Montaje Montaje superficial | ||
Tipo de Encapsulado TSSOP | ||
Conteo de Pines 20 | ||
Dimensiones 6.6 x 4.5 x 0.95mm | ||
Altura 0.95mm | ||
Longitud 6.6mm | ||
Ancho 4.5mm | ||
Tensión de Alimentación de Funcionamiento Mínima 1,2 V | ||
Temperatura de Funcionamiento Mínima -40 °C | ||
Temperatura Máxima de Funcionamiento +125 °C | ||
Tensión de Alimentación Máxima de Funcionamiento 3,6 V | ||
- COO (País de Origen):
- CN
El modelo 74LVC573A consta de ocho enclavamientos transparentes tipo D con entradas tipo D independientes para cada enclavamiento y salidas reales de 3 estados para aplicaciones orientadas a bus. Una entrada de activación de enclavamiento (LE) y una entrada de activación de salida (OE) son comunes para todos los enclavamientos internos. Cuando LE es ALTA, los datos de las entradas Dn entran en los enclavamientos. En esta condición los enclavamientos son transparentes, es decir, una salida de bloqueo cambiará cada vez que cambie su entrada D correspondiente.
Aplicaciones mixtas, 5 V y 3,3 V
Ahorre espacio de placa
Soluciones de interfaz de bajo coste
Mejora de la integridad de señal en diseños complejos
Amplio rango de tensión de entrada
Retardo de propagación baja
Tolerante a sobretensión
Terminación de fuente
Umbral de entrada bajo
CMOS, baja potencia
Controladores de memoria
Interfaces de panel posterior
Ahorre espacio de placa
Soluciones de interfaz de bajo coste
Mejora de la integridad de señal en diseños complejos
Amplio rango de tensión de entrada
Retardo de propagación baja
Tolerante a sobretensión
Terminación de fuente
Umbral de entrada bajo
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