Latch SN74LVC573APWR, Transparente Tipo D 3 estados TSSOP 20 pines 8bit
- Código RS:
- 662-9089
- Nº ref. fabric.:
- SN74LVC573APWR
- Fabricante:
- Texas Instruments
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*precio indicativo
- Código RS:
- 662-9089
- Nº ref. fabric.:
- SN74LVC573APWR
- Fabricante:
- Texas Instruments
Especificaciones
Documentación Técnica
Legislación y Conformidad
Datos del Producto
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Seleccionar todo | Atributo | Valor |
|---|---|---|
| Marca | Texas Instruments | |
| Familia Lógica | LVC | |
| Modo de Enclavamiento | Transparente | |
| Elemento de Enclavamiento | Tipo D | |
| Número de Bits | 8bit | |
| Tipo de Salida | 3 estados | |
| Polaridad | No Inversión | |
| Tipo de Montaje | Montaje superficial | |
| Tipo de Encapsulado | TSSOP | |
| Conteo de Pines | 20 | |
| Dimensiones | 6.5 x 4.4 x 1.15mm | |
| Altura | 1.15mm | |
| Longitud | 6.5mm | |
| Temperatura Máxima de Funcionamiento | +85 °C | |
| Temperatura de Funcionamiento Mínima | -40 °C | |
| Ancho | 4.4mm | |
| Tensión de Alimentación de Funcionamiento Mínima | 1.65 V | |
| Tensión de Alimentación Máxima de Funcionamiento | 3.6 V | |
| Seleccionar todo | ||
|---|---|---|
Marca Texas Instruments | ||
Familia Lógica LVC | ||
Modo de Enclavamiento Transparente | ||
Elemento de Enclavamiento Tipo D | ||
Número de Bits 8bit | ||
Tipo de Salida 3 estados | ||
Polaridad No Inversión | ||
Tipo de Montaje Montaje superficial | ||
Tipo de Encapsulado TSSOP | ||
Conteo de Pines 20 | ||
Dimensiones 6.5 x 4.4 x 1.15mm | ||
Altura 1.15mm | ||
Longitud 6.5mm | ||
Temperatura Máxima de Funcionamiento +85 °C | ||
Temperatura de Funcionamiento Mínima -40 °C | ||
Ancho 4.4mm | ||
Tensión de Alimentación de Funcionamiento Mínima 1.65 V | ||
Tensión de Alimentación Máxima de Funcionamiento 3.6 V | ||
Registros y biestables de la familia 74LVC, Texas Instruments
Gama de registros y biestables de la familia 74LVC de los CI de lógica CMOS de baja tensión de Texas Instruments. La familia 74LVC utiliza tecnología CMOS de puerta de silicio y está diseñada para funcionar a 3,3 V, lo que permite una reducción significativa del consumo de energía en comparación con los sistemas de 5 V.
Tensión de funcionamiento: 1,65 a +3,6 V
Entradas tolerantes de 5 V
Compatibilidad: entrada LVTTL/TTL, salida LVCMOS
El rendimiento de cierre excede 250 mA conforme a JESD 17
La protección contra ESD excede JESD 22
Entradas tolerantes de 5 V
Compatibilidad: entrada LVTTL/TTL, salida LVCMOS
El rendimiento de cierre excede 250 mA conforme a JESD 17
La protección contra ESD excede JESD 22
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