Búfer de reloj 2305-1DCGI8, SOIC/TSSOP, 8-pin
- Código RS:
- 235-8695
- Nº ref. fabric.:
- 2305-1DCGI8
- Fabricante:
- Renesas Electronics
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- Código RS:
- 235-8695
- Nº ref. fabric.:
- 2305-1DCGI8
- Fabricante:
- Renesas Electronics
Especificaciones
Documentación Técnica
Legislación y Conformidad
Datos del Producto
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Seleccionar todo | Atributo | Valor |
|---|---|---|
| Marca | Renesas Electronics | |
| Corriente de Alimentación Máxima | 32 mA | |
| Tipo de Montaje | Montaje superficial | |
| Tipo de Encapsulado | SOIC/TSSOP | |
| Conteo de Pines | 8 | |
| Dimensiones | 4.90 x 3.90 x 1.50mm | |
| Longitud | 4.9mm | |
| Ancho | 3.9mm | |
| Altura | 1.5mm | |
| Tensión de Alimentación Máxima de Funcionamiento | 3,6 V | |
| Temperatura Máxima de Funcionamiento | 85 °C | |
| Frecuencia de Salida Máxima | 133MHZ | |
| Tensión de Alimentación de Funcionamiento Mínima | 3 V | |
| Frecuencia de Salida Mínima | 10MHZ | |
| Temperatura de Funcionamiento Mínima | -40 °C | |
| Seleccionar todo | ||
|---|---|---|
Marca Renesas Electronics | ||
Corriente de Alimentación Máxima 32 mA | ||
Tipo de Montaje Montaje superficial | ||
Tipo de Encapsulado SOIC/TSSOP | ||
Conteo de Pines 8 | ||
Dimensiones 4.90 x 3.90 x 1.50mm | ||
Longitud 4.9mm | ||
Ancho 3.9mm | ||
Altura 1.5mm | ||
Tensión de Alimentación Máxima de Funcionamiento 3,6 V | ||
Temperatura Máxima de Funcionamiento 85 °C | ||
Frecuencia de Salida Máxima 133MHZ | ||
Tensión de Alimentación de Funcionamiento Mínima 3 V | ||
Frecuencia de Salida Mínima 10MHZ | ||
Temperatura de Funcionamiento Mínima -40 °C | ||
El búfer de reloj de bucle de bloqueo de fase de alta velocidad Renesas Electronics está diseñado para aplicaciones de distribución de reloj de alta velocidad. El retardo a cero se logra alineando la fase entre el reloj entrante y el reloj de salida, operable dentro del rango de 10 a 133MHz. El IDT2305 es una versión de ocho contactos del IDT2309. El IDT2305 acepta una entrada de referencia y acciona cinco relojes de diferencial bajo.
Distribución de reloj de bucle de bloqueo de fase
Distribuye una entrada de reloj a un banco de cinco salidas
Retardo de salida de entrada cero
No se necesita una red rc externa
Disponible en encapsulados SOIC y tssop
Distribuye una entrada de reloj a un banco de cinco salidas
Retardo de salida de entrada cero
No se necesita una red rc externa
Disponible en encapsulados SOIC y tssop