Renesas Electronics Búfer de reloj 9DB233AGILF TSSOP, 20 pines
- Código RS:
- 263-7983
- Nº ref. fabric.:
- 9DB233AGILF
- Fabricante:
- Renesas Electronics
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Unidad(es) | Por unidad | Por Paquete* |
|---|---|---|
| 2 - 8 | 3,955 € | 7,91 € |
| 10 - 18 | 3,56 € | 7,12 € |
| 20 - 24 | 3,485 € | 6,97 € |
| 26 - 72 | 3,36 € | 6,72 € |
| 74 + | 2,91 € | 5,82 € |
*precio indicativo
- Código RS:
- 263-7983
- Nº ref. fabric.:
- 9DB233AGILF
- Fabricante:
- Renesas Electronics
Especificaciones
Documentación Técnica
Legislación y Conformidad
Datos del Producto
Encuentra productos similares seleccionando uno o varios atributos.
Seleccionar todo | Atributo | Valor |
|---|---|---|
| Marca | Renesas Electronics | |
| Tipo de producto | Búfer de reloj | |
| Frecuencia de entrada máxima | 110MHz | |
| Tipo de montaje | Superficie | |
| Encapsulado | TSSOP | |
| Número de pines | 20 | |
| Número de Salidas | 2 | |
| Tensión de alimentación mínima | 3.3V | |
| Tensión de alimentación máxima | 4.6V | |
| Temperatura de Funcionamiento Mínima | -40°C | |
| Temperatura de funcionamiento máxima | 85°C | |
| Certificaciones y estándares | RoHS | |
| Longitud | 6.6mm | |
| Serie | 9DB233 | |
| Anchura | 4.4 mm | |
| Altura | 1.2mm | |
| Estándar de automoción | No | |
| Seleccionar todo | ||
|---|---|---|
Marca Renesas Electronics | ||
Tipo de producto Búfer de reloj | ||
Frecuencia de entrada máxima 110MHz | ||
Tipo de montaje Superficie | ||
Encapsulado TSSOP | ||
Número de pines 20 | ||
Número de Salidas 2 | ||
Tensión de alimentación mínima 3.3V | ||
Tensión de alimentación máxima 4.6V | ||
Temperatura de Funcionamiento Mínima -40°C | ||
Temperatura de funcionamiento máxima 85°C | ||
Certificaciones y estándares RoHS | ||
Longitud 6.6mm | ||
Serie 9DB233 | ||
Anchura 4.4 mm | ||
Altura 1.2mm | ||
Estándar de automoción No | ||
- COO (País de Origen):
- TW
El búfer de retardo cero de Renesas Electronics admite requisitos de reloj PCIe Gen1 y Gen2. Se acciona por un par de salida SRC diferencial de un generador de reloj principal IDT. Atenua el jitter en el reloj de entrada y tiene un ancho de banda PLL seleccionable para maximizar el rendimiento en sistemas con o sin reloj de espectro extendido.
Interfaz SMBus
Ancho de banda PLL seleccionable
Minimiza el pico de jitter en PLL descendentes
Jitter ciclo a ciclo < 50ps
Desviación de salida a salida < 50 ps
Disparo de fase PCIe Gen3 < 1,0 ps RMS