Infineon Búfer de reloj CY2305SXI-1 SOIC, 8 pines
- Código RS:
- 273-7326
- Nº ref. fabric.:
- CY2305SXI-1
- Fabricante:
- Infineon
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Unidad(es) | Por unidad | Por Tubo* |
|---|---|---|
| 97 - 97 | 1,823 € | 176,83 € |
| 194 + | 1,747 € | 169,46 € |
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- Código RS:
- 273-7326
- Nº ref. fabric.:
- CY2305SXI-1
- Fabricante:
- Infineon
Especificaciones
Documentación Técnica
Legislación y Conformidad
Datos del Producto
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Seleccionar todo | Atributo | Valor |
|---|---|---|
| Marca | Infineon | |
| Tipo de producto | Búfer de reloj | |
| Frecuencia de entrada máxima | 133MHZ | |
| Tiempo de retardo de propagación máximo | 8.7ns | |
| Tipo de montaje | Superficie | |
| Encapsulado | SOIC | |
| Número de pines | 8 | |
| Tensión de alimentación mínima | 3V | |
| Tensión de alimentación máxima | 3.6V | |
| Temperatura de Funcionamiento Mínima | 0°C | |
| Temperatura de funcionamiento máxima | 70°C | |
| Serie | CY2305 | |
| Certificaciones y estándares | No | |
| Altura | 1.5mm | |
| Longitud | 5.84mm | |
| Estándar de automoción | No | |
| Seleccionar todo | ||
|---|---|---|
Marca Infineon | ||
Tipo de producto Búfer de reloj | ||
Frecuencia de entrada máxima 133MHZ | ||
Tiempo de retardo de propagación máximo 8.7ns | ||
Tipo de montaje Superficie | ||
Encapsulado SOIC | ||
Número de pines 8 | ||
Tensión de alimentación mínima 3V | ||
Tensión de alimentación máxima 3.6V | ||
Temperatura de Funcionamiento Mínima 0°C | ||
Temperatura de funcionamiento máxima 70°C | ||
Serie CY2305 | ||
Certificaciones y estándares No | ||
Altura 1.5mm | ||
Longitud 5.84mm | ||
Estándar de automoción No | ||
El búfer de retardo cero de Infineon está diseñado para distribuir relojes de alta velocidad. Acepta una entrada de referencia y ejecuta cinco relojes de baja desviación. Todas las piezas tienen PLL en chip que se bloquean a un reloj de entrada en el contacto REF. La retroalimentación PLL está en el chip y se obtiene de la almohadilla CLKOUT. Estos dispositivos de búfer pueden aceptar el mismo reloj de entrada y distribuirlo. En este caso, se garantiza que la desviación entre las salidas de dos dispositivos sea inferior a 700 ps.
Jitter típico de ciclo a ciclo de 60 ps
Retardo de propagación de salida de entrada cero
Modo de prueba para evitar el bucle de bloqueo de fase
Compatible con sistemas basados en Pentium
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