STMicroelectronics Microprocesador STM32MP231AAJ3 STM32MP23xA/D ARM Cortex A35, ARM Cortex M33 16 bit ARM Cortex, ARM
- Código RS:
- 482-980
- Nº ref. fabric.:
- STM32MP231AAJ3
- Fabricante:
- STMicroelectronics
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Especificaciones
Documentación Técnica
Legislación y Conformidad
Datos del Producto
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Seleccionar todo | Atributo | Valor |
|---|---|---|
| Marca | STMicroelectronics | |
| Tipo de producto | Microprocesador | |
| Serie | STM32MP23xA/D | |
| Núcleo del dispositivo | ARM Cortex A35, ARM Cortex M33 | |
| Ancho del bus de datos | 16bit | |
| Arquitectura del juego de instrucciones | ARM Cortex, ARM V8-M, 64 bits | |
| Frecuencia del reloj máxima | 1.5GHz | |
| Tipo de interfaz | UART, SDM, SAI, SPI, USB 2.0, SPDIF, USART, I2C, I3C, DDR4, CAN, Ethernet, NAND, DDR3L, FMC, LPDDR4 | |
| Encapsulado | TFBGA361 | |
| Tensión de alimentación mínima | 1.71V | |
| Número de pines | 361 | |
| Tensión de alimentación máxima | 3.6V | |
| Certificaciones y estándares | IEEE 1588v2, JEDEC, ECOPACK2 | |
| Número de núcleos | 2 | |
| Estándar de automoción | No | |
| Seleccionar todo | ||
|---|---|---|
Marca STMicroelectronics | ||
Tipo de producto Microprocesador | ||
Serie STM32MP23xA/D | ||
Núcleo del dispositivo ARM Cortex A35, ARM Cortex M33 | ||
Ancho del bus de datos 16bit | ||
Arquitectura del juego de instrucciones ARM Cortex, ARM V8-M, 64 bits | ||
Frecuencia del reloj máxima 1.5GHz | ||
Tipo de interfaz UART, SDM, SAI, SPI, USB 2.0, SPDIF, USART, I2C, I3C, DDR4, CAN, Ethernet, NAND, DDR3L, FMC, LPDDR4 | ||
Encapsulado TFBGA361 | ||
Tensión de alimentación mínima 1.71V | ||
Número de pines 361 | ||
Tensión de alimentación máxima 3.6V | ||
Certificaciones y estándares IEEE 1588v2, JEDEC, ECOPACK2 | ||
Número de núcleos 2 | ||
Estándar de automoción No | ||
- COO (País de Origen):
- TW
El núcleo RISC de 64 bits Arm Cortex-A35 de uno o dos núcleos de alto rendimiento de STMicroelectronics funciona hasta a 1,5 GHz. El procesador Cortex-A35 incluye una caché de instrucciones L1 de 32 Kb para cada CPU, una caché de datos L1 de 32 Kb para cada CPU y una caché L2 de 512 Kb. El procesador Cortex-A35 utiliza un pipeline de orden interno de 8 etapas altamente eficiente que se ha optimizado ampliamente para ofrecer todas las funciones de Armv8-A al tiempo que se maximiza la eficiencia energética y de área.
Cuatro USART y tres UART
Una UART de bajo consumo
Cuatro interfaces de audio serie SAI
Una interfaz SPDIF Rx
Tres interfaces SDMMC
Host USB 2.0 con PHY de alta velocidad integrado
USB 2.0 dual-role data con Hi-Speed PHYs
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