Intelligent Memory AEC-Q100 SDRAM IME5132SDBETG-6I, 256 MB, Superficie, FBGA 16 bit, 90 pines
- Código RS:
- 588-607
- Nº ref. fabric.:
- IME5132SDBETG-6I
- Fabricante:
- Intelligent Memory
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- Código RS:
- 588-607
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- IME5132SDBETG-6I
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- Intelligent Memory
Especificaciones
Documentación Técnica
Legislación y Conformidad
Datos del Producto
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Seleccionar todo | Atributo | Valor |
|---|---|---|
| Tipo de producto | SDRAM | |
| Tamaño de la memoria | 256MB | |
| Ancho del bus de datos | 16bit | |
| Frecuencia del reloj máxima | 166MHZ | |
| Número de bits por palabra | 32 | |
| Tiempo de acceso aleatorio máximo | 6ns | |
| Número de palabras | 16 | |
| Tipo de montaje | Superficie | |
| Encapsulado | FBGA | |
| Temperatura de Funcionamiento Mínima | -40°C | |
| Número de pines | 90 | |
| Temperatura de funcionamiento máxima | 85°C | |
| Longitud | 13mm | |
| Certificaciones y estándares | JEDEC, RoHS | |
| Serie | IME5132SDBE | |
| Altura | 1.2mm | |
| Tensión de alimentación mínima | 3V | |
| Corriente de suministro | 110mA | |
| Estándar de automoción | AEC-Q100 | |
| Tensión de alimentación máxima | 3.6V | |
| Seleccionar todo | ||
|---|---|---|
Tipo de producto SDRAM | ||
Tamaño de la memoria 256MB | ||
Ancho del bus de datos 16bit | ||
Frecuencia del reloj máxima 166MHZ | ||
Número de bits por palabra 32 | ||
Tiempo de acceso aleatorio máximo 6ns | ||
Número de palabras 16 | ||
Tipo de montaje Superficie | ||
Encapsulado FBGA | ||
Temperatura de Funcionamiento Mínima -40°C | ||
Número de pines 90 | ||
Temperatura de funcionamiento máxima 85°C | ||
Longitud 13mm | ||
Certificaciones y estándares JEDEC, RoHS | ||
Serie IME5132SDBE | ||
Altura 1.2mm | ||
Tensión de alimentación mínima 3V | ||
Corriente de suministro 110mA | ||
Estándar de automoción AEC-Q100 | ||
Tensión de alimentación máxima 3.6V | ||
- COO (País de Origen):
- TW
La memoria inteligente DRAM síncrona de cuatro bancos está organizada como 4 bancos x 4Mbit x 32. Alcanza velocidades de transferencia de datos de alta velocidad de hasta 166 MHz empleando una arquitectura de chip que preconfigura múltiples bits y sincroniza los datos de salida con el reloj del sistema, garantizando un rendimiento eficaz y fiable.
Modo de apagado
Actualización automática y autorrenovación
Mando de precarga automático y controlado
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