SDRAM AS4C1G8D4A-62BIN, 1GBit, Montaje superficial, FBGA, 78 pines DDR4
- Código RS:
- 665-384
- Nº ref. fabric.:
- AS4C1G8D4A-62BIN
- Fabricante:
- Alliance Memory
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- Código RS:
- 665-384
- Nº ref. fabric.:
- AS4C1G8D4A-62BIN
- Fabricante:
- Alliance Memory
Especificaciones
Documentación Técnica
Legislación y Conformidad
Datos del Producto
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Seleccionar todo | Atributo | Valor |
|---|---|---|
| Marca | Alliance Memory | |
| Tamaño de la Memoria | 1GBit | |
| Clase SDRAM | DDR4 | |
| Organización | 1G x 8 | |
| Ancho del Bus de Datos | 8bit | |
| Tipo de Montaje | Montaje superficial | |
| Tipo de Encapsulado | FBGA | |
| Conteo de Pines | 78 | |
| Seleccionar todo | ||
|---|---|---|
Marca Alliance Memory | ||
Tamaño de la Memoria 1GBit | ||
Clase SDRAM DDR4 | ||
Organización 1G x 8 | ||
Ancho del Bus de Datos 8bit | ||
Tipo de Montaje Montaje superficial | ||
Tipo de Encapsulado FBGA | ||
Conteo de Pines 78 | ||
- COO (País de Origen):
- TW
La DRAM DDR4 de 8 Gb de Alliance Memory en un encapsulado FBGA de 78 bolas admite especificaciones de jitter de reloj JEDEC y dispone de una estroboscopia de datos diferencial bidireccional junto con relojes diferenciales. Está organizado internamente en 16 bancos, agrupados en cuatro juegos de cuatro bancos cada uno, con estructuras de puerta de E/S separadas por grupo bancario. El dispositivo utiliza una arquitectura de prefijo de 8 n bits y admite características de ahorro de energía como precarga y desconexión activa, actualización automática, actualización automática, actualización automática de baja potencia (LPASR), interrupción de actualización automática y actualización de granularidad fina, lo que garantiza un funcionamiento eficiente y de alto rendimiento.
Formación VREFDQ interna
Entrenamiento de preámbulo de lectura
Modo de reducción de engranajes de control
Dirigibilidad por DRAM
Control de impedancia de controlador de salida
Terminación de encendido dinámica
Entrenamiento de preámbulo de lectura
Modo de reducción de engranajes de control
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