Lattice Semiconductor FPGA iCE40LP1K-CM49 iCE40 LP/HX 1280 celdas, 64 kB 160 bloques, 49 pines UCBGA
- Código RS:
- 772-0085
- Nº ref. fabric.:
- iCE40LP1K-CM49
- Fabricante:
- Lattice Semiconductor
No disponible actualmente
Desconocemos si volveremos a disponer de este artículo. RS tiene previsto retirarlo próximamente de nuestra gama de productos.
- Código RS:
- 772-0085
- Nº ref. fabric.:
- iCE40LP1K-CM49
- Fabricante:
- Lattice Semiconductor
Especificaciones
Documentación Técnica
Legislación y Conformidad
Datos del Producto
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Seleccionar todo | Atributo | Valor |
|---|---|---|
| Marca | Lattice Semiconductor | |
| Serie | iCE40 LP/HX | |
| Tipo de producto | FPGA | |
| Número de células lógicas | 1280 | |
| Número de unidades lógicas | 160 | |
| Número de registros | 1280 | |
| Tipo de montaje | Superficie | |
| Tensión de alimentación mínima | 1.14V | |
| Encapsulado | UCBGA | |
| Número de pines | 49 | |
| Tensión de alimentación máxima | 1.26V | |
| Número de bits de RAM | 64kB | |
| Temperatura de Funcionamiento Mínima | -40°C | |
| Temperatura de funcionamiento máxima | 85°C | |
| Certificaciones y estándares | Halogen Free | |
| Longitud | 3mm | |
| Altura | 900μm | |
| Estándar de automoción | No | |
| Seleccionar todo | ||
|---|---|---|
Marca Lattice Semiconductor | ||
Serie iCE40 LP/HX | ||
Tipo de producto FPGA | ||
Número de células lógicas 1280 | ||
Número de unidades lógicas 160 | ||
Número de registros 1280 | ||
Tipo de montaje Superficie | ||
Tensión de alimentación mínima 1.14V | ||
Encapsulado UCBGA | ||
Número de pines 49 | ||
Tensión de alimentación máxima 1.26V | ||
Número de bits de RAM 64kB | ||
Temperatura de Funcionamiento Mínima -40°C | ||
Temperatura de funcionamiento máxima 85°C | ||
Certificaciones y estándares Halogen Free | ||
Longitud 3mm | ||
Altura 900μm | ||
Estándar de automoción No | ||
Field Programmable Gate Arrays, Lattice Semiconductor
An FPGA is a semiconductor device consisting of a Matrix of Configurable Logic Blocks (CLBs) connected through programmable interconnects. The user determines these interconnections by programming SRAM. A CLB can be simple (AND, OR gates, etc) or complex (a Block of RAM). The FPGA allows changes to be MADE to a design even after the device is soldered into a PCB.
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