Alliance Memory AEC-Q100 SDRAM AS4C128M16D2A-25BAN, 256 MB, Montaje superficial, FBGA 16 bit, 84 pines
- Código RS:
- 842-637
- Nº ref. fabric.:
- AS4C128M16D2A-25BAN
- Fabricante:
- Alliance Memory
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- Fabricante:
- Alliance Memory
Especificaciones
Documentación Técnica
Legislación y Conformidad
Datos del Producto
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Seleccionar todo | Atributo | Valor |
|---|---|---|
| Tipo de producto | SDRAM | |
| Tamaño de la memoria | 256MB | |
| Ancho del bus de datos | 16bit | |
| Número de bits por palabra | 16 | |
| Frecuencia del reloj máxima | 400MHZ | |
| Tiempo de acceso aleatorio máximo | 0.4ns | |
| Tipo de montaje | Montaje superficial | |
| Encapsulado | FBGA | |
| Temperatura de Funcionamiento Mínima | -40°C | |
| Número de pines | 84 | |
| Temperatura de funcionamiento máxima | 105°C | |
| Serie | AS4C128M16D2A | |
| Certificaciones y estándares | RoHS | |
| Tensión de alimentación máxima | 1.9V | |
| Estándar de automoción | AEC-Q100 | |
| Tensión de alimentación mínima | 1.7V | |
| Seleccionar todo | ||
|---|---|---|
Tipo de producto SDRAM | ||
Tamaño de la memoria 256MB | ||
Ancho del bus de datos 16bit | ||
Número de bits por palabra 16 | ||
Frecuencia del reloj máxima 400MHZ | ||
Tiempo de acceso aleatorio máximo 0.4ns | ||
Tipo de montaje Montaje superficial | ||
Encapsulado FBGA | ||
Temperatura de Funcionamiento Mínima -40°C | ||
Número de pines 84 | ||
Temperatura de funcionamiento máxima 105°C | ||
Serie AS4C128M16D2A | ||
Certificaciones y estándares RoHS | ||
Tensión de alimentación máxima 1.9V | ||
Estándar de automoción AEC-Q100 | ||
Tensión de alimentación mínima 1.7V | ||
- COO (País de Origen):
- TW
La solución de memoria CMOS de alta velocidad Double-Data-Rate-Two de Alliance Memory proporciona funcionalidad de memoria de acceso aleatorio dinámica síncrona, combinando 2048 Mbits en una configuración de 16 bits de ancho, adaptada para aplicaciones de automoción.
Conformidad con el estándar JEDEC con E/S de 1,8 V y conformidad con AEC-Q100
Velocidad de reloj rápida de 400 MHz con funcionamiento completamente síncrono
Admite accesos orientados a ráfagas de 4 u 8 bits para mejorar el rendimiento
Incluye registros internos de precarga y modo programable para mayor eficiencia operativa